[红包]TSV：韬定律最核心变化，芯片的 垂直高速电梯！抛光液龙头重点受益！
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华为韬定律，从2.5d 到3d变化，当前最突出、最核心、最明确的变化环节--TSV！
TSV：立体堆叠芯片工艺里的 "垂直高速电梯"！！
TSV（硅通孔，Through-Silicon Via）就是在硅芯片本身打穿的、密密麻麻的 "垂直电梯井"，专门用来让上下堆叠的芯片之间直接通电传数据，是 3D 芯片能跑起来的核心命脉。
一、先搞懂：没有 TSV 之前，芯片怎么 "说话"？
你可以把每一块芯片都想象成一栋 100 层的写字楼，里面全是密密麻麻的办公室（晶体管），所有办公室之间的电话线（金属连线）都只能在楼内横向走，不能上下穿楼层。
1. 传统 2D 芯片：独栋写字楼所有功能（CPU、GPU、缓存）都挤在同一栋楼里，楼越盖越大，办公室越摆越密，但电话线只能在平面上绕，越绕越长，速度变慢还费电。
2. 2.5D 芯片：同一个广场上的多栋楼这就是你说的 "芯片平铺在大硅中介层上"：把 CPU、GPU、内存拆成好几栋小楼，都建在同一个大广场（硅中介层）上楼和楼之间说话，只能走广场上的马路（中介层的横向连线）广场和下面的停车场（电路板）之间，只有广场边缘有几个很粗的楼梯（2.5D 的 TSV）
缺点：马路再宽也会堵车，而且所有数据都要绕广场走，速度慢、费电，广场本身也很贵
二、3D 堆叠的 TSV：
直接在楼里打垂直电梯3D 堆叠就是把好几栋写字楼直接上下叠起来（Die-on-Die），比如 CPU 楼在下面，内存楼在上面。这时候如果还靠楼边缘搭梯子传数据，早就堵死了。TSV 就是解决这个问题的：直接在每一栋楼的地板上，打穿成千上万根垂直的电梯井，从一楼直通顶楼。
2.5D TSV vs 3D TSV 核心区别（用电梯比喻）表格
三、华为论文里的 3 个 TSV 黑科技
"TSV 焊盘仅位于顶层金属下方一级"相当于：
电梯的出口直接开在离楼顶最近的那一层，不用再走楼梯绕到其他楼层好处：数据传输距离最短，速度最快，损耗最小"混合键合间距达到 1.5 微米"混合键合就是：上下两栋楼的电梯口，直接用铜焊盘焊死对齐，不用再垫螺丝垫片1.5 微米间距：每平方厘米可以打超过 40 万个电梯口，整个芯片表面都能互联，不再局限于芯片边缘"ALD Al₂O₃是键合界面的核心绝缘膜"电梯井的内壁必须刷一层绝缘漆，不然电流（电梯）会漏到楼体（硅片）里，或者上下电梯会串线短路ALD（原子层沉积）就是：用原子级的精度，一层一层地刷绝缘漆，刷得极薄又绝对均匀没有这层漆，铜焊盘会互相扩散、短路、键合不牢，3D 堆叠直接报废。
例子 1：手机内存为什么突然变快了？以前的手机：CPU 芯片和内存芯片是分开的两个芯片，就像两栋楼隔了一条马路，CPU 要取数据，得先出楼、过马路、进内存楼，来回一趟要几百纳秒。用了 3D TSV 之后：把内存芯片直接叠在 CPU 芯片上面，CPU 要取数据，直接坐垂直电梯到内存那一层，几纳秒就到了，速度快 100 倍，还能省一半的电。
例子 2：长江存储的 Xtacking 技术长江存储的 3D NAND 闪存，就是把 "存储单元楼" 和 "控制电路楼" 分开制造，然后用 TSV + 混合键合技术叠在一起。以前：控制电路只能放在存储单元的周围，芯片面积大，成本高现在：控制电路直接叠在存储单元下面，整个芯片面积缩小 30%，速度提升 50%，成本大幅降低；
四、为什么 TSV 是最大的机会？？
从 2.5D 到 3D，本质上是芯片互连方式的革命：从 "平面马路运输" 变成 "垂直电梯运输"。
hw 实测混合键合间距达到1.5微米；TSV焊盘仅位于顶层金属下方一级； 3D制造良率接近100%。
核心技术：
tsv2.5D：
1）芯片平铺在一块大硅中介层（Interposer）上
2）互连：微凸点→中介层TSV→基板互连方向：横向为主
3）tsv：TSV只在中介层里，用来从顶层穿到底层，孔大！
3D：
1）芯片直接上下堆叠（Die-on-Die）互连：直接键合（Hybrid Bonding）+ 硅通孔TSV互连方向：纵向为主。
2）tsv：TSV直接穿芯片本身（晶圆级TSV）孔径小、密度极高、必须ALD超薄侧壁绝缘难度大、良率要求极高！
而 TSV 就是这个垂直运输系统的核心，它需要一整套全新的设备：
TSV上游：抛光液+抛光垫（鼎龙股份）
打电梯井：刻蚀机（中微公司、北方华创）
刷绝缘漆：ALD 设备（拓荆科技、北方华创）
填电梯井：电镀设备（北方华创）检测电梯有没有坏：
检测设备（精测电子）把上下楼的电梯口对齐焊死：
键合设备（国产正在突破）华为这次把 3D TSV 的良率做到接近 100%，
相当于宣布这条技术路线已经通了，接下来就是全产业链的大规模放量，
整体利好几乎所有国产半导体设备，
TSV：立体堆叠芯片工艺里的 "垂直高速电梯"！！
TSV（硅通孔，Through-Silicon Via）就是在硅芯片本身打穿的、密密麻麻的 "垂直电梯井"，专门用来让上下堆叠的芯片之间直接通电传数据，是 3D 芯片能跑起来的核心命脉。
一、先搞懂：没有 TSV 之前，芯片怎么 "说话"？
你可以把每一块芯片都想象成一栋 100 层的写字楼，里面全是密密麻麻的办公室（晶体管），所有办公室之间的电话线（金属连线）都只能在楼内横向走，不能上下穿楼层。
1. 传统 2D 芯片：独栋写字楼所有功能（CPU、GPU、缓存）都挤在同一栋楼里，楼越盖越大，办公室越摆越密，但电话线只能在平面上绕，越绕越长，速度变慢还费电。
2. 2.5D 芯片：同一个广场上的多栋楼这就是你说的 "芯片平铺在大硅中介层上"：把 CPU、GPU、内存拆成好几栋小楼，都建在同一个大广场（硅中介层）上楼和楼之间说话，只能走广场上的马路（中介层的横向连线）广场和下面的停车场（电路板）之间，只有广场边缘有几个很粗的楼梯（2.5D 的 TSV）
缺点：马路再宽也会堵车，而且所有数据都要绕广场走，速度慢、费电，广场本身也很贵
二、3D 堆叠的 TSV：
直接在楼里打垂直电梯3D 堆叠就是把好几栋写字楼直接上下叠起来（Die-on-Die），比如 CPU 楼在下面，内存楼在上面。这时候如果还靠楼边缘搭梯子传数据，早就堵死了。TSV 就是解决这个问题的：直接在每一栋楼的地板上，打穿成千上万根垂直的电梯井，从一楼直通顶楼。
2.5D TSV vs 3D TSV 核心区别（用电梯比喻）表格
| 对比项2.5D 的 TSV3D 的 TSV（华为这次秀的）打在哪里 | 只打在 "广场"（中介层）里 | 直接打在每一栋 "楼"（芯片本身）里 |
| 电梯粗细 | 井道极粗（像货梯），数量少 | 井道极细（像家用电梯），数量多 100 倍以上 |
| 作用 | 只负责广场顶层到底层的运输 | 负责上下两栋楼之间任意房间的直达运输 |
| 难度 | 低，良率高 | 极高，以前良率上不去，现在华为做到接近 100% |
三、华为论文里的 3 个 TSV 黑科技
"TSV 焊盘仅位于顶层金属下方一级"相当于：
电梯的出口直接开在离楼顶最近的那一层，不用再走楼梯绕到其他楼层好处：数据传输距离最短，速度最快，损耗最小"混合键合间距达到 1.5 微米"混合键合就是：上下两栋楼的电梯口，直接用铜焊盘焊死对齐，不用再垫螺丝垫片1.5 微米间距：每平方厘米可以打超过 40 万个电梯口，整个芯片表面都能互联，不再局限于芯片边缘"ALD Al₂O₃是键合界面的核心绝缘膜"电梯井的内壁必须刷一层绝缘漆，不然电流（电梯）会漏到楼体（硅片）里，或者上下电梯会串线短路ALD（原子层沉积）就是：用原子级的精度，一层一层地刷绝缘漆，刷得极薄又绝对均匀没有这层漆，铜焊盘会互相扩散、短路、键合不牢，3D 堆叠直接报废。
例子 1：手机内存为什么突然变快了？以前的手机：CPU 芯片和内存芯片是分开的两个芯片，就像两栋楼隔了一条马路，CPU 要取数据，得先出楼、过马路、进内存楼，来回一趟要几百纳秒。用了 3D TSV 之后：把内存芯片直接叠在 CPU 芯片上面，CPU 要取数据，直接坐垂直电梯到内存那一层，几纳秒就到了，速度快 100 倍，还能省一半的电。
例子 2：长江存储的 Xtacking 技术长江存储的 3D NAND 闪存，就是把 "存储单元楼" 和 "控制电路楼" 分开制造，然后用 TSV + 混合键合技术叠在一起。以前：控制电路只能放在存储单元的周围，芯片面积大，成本高现在：控制电路直接叠在存储单元下面，整个芯片面积缩小 30%，速度提升 50%，成本大幅降低；
四、为什么 TSV 是最大的机会？？
从 2.5D 到 3D，本质上是芯片互连方式的革命：从 "平面马路运输" 变成 "垂直电梯运输"。
hw 实测混合键合间距达到1.5微米；TSV焊盘仅位于顶层金属下方一级； 3D制造良率接近100%。
核心技术：
tsv2.5D：
1）芯片平铺在一块大硅中介层（Interposer）上
2）互连：微凸点→中介层TSV→基板互连方向：横向为主
3）tsv：TSV只在中介层里，用来从顶层穿到底层，孔大！
3D：
1）芯片直接上下堆叠（Die-on-Die）互连：直接键合（Hybrid Bonding）+ 硅通孔TSV互连方向：纵向为主。
2）tsv：TSV直接穿芯片本身（晶圆级TSV）孔径小、密度极高、必须ALD超薄侧壁绝缘难度大、良率要求极高！
而 TSV 就是这个垂直运输系统的核心，它需要一整套全新的设备：
TSV上游：抛光液+抛光垫（鼎龙股份）
打电梯井：刻蚀机（中微公司、北方华创）
刷绝缘漆：ALD 设备（拓荆科技、北方华创）
填电梯井：电镀设备（北方华创）检测电梯有没有坏：
检测设备（精测电子）把上下楼的电梯口对齐焊死：
键合设备（国产正在突破）华为这次把 3D TSV 的良率做到接近 100%，
相当于宣布这条技术路线已经通了，接下来就是全产业链的大规模放量，
整体利好几乎所有国产半导体设备，
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